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¿Multitransistores (FinFET) compartiendo una puerta?

Para que quede claro, aún no he tomado ningún curso relacionado con la electrónica (todavía). Por lo tanto, estoy bastante limitado en mi conocimiento sobre la electrónica. Me he enseñado muchas cosas a mí mismo usando Internet, pero tengo claro que la auto-enseñanza no da los mejores resultados, aunque pueda ayudar. Dicho esto, es probable que sepa muy poco sobre la ciencia de los transistores, lo que me lleva a hacer esta pregunta.

Sé que los transistores están entre los componentes más fundamentales de los dispositivos electrónicos, y que para producir transistores con mejor rendimiento, se han desarrollado los transistores FinFET:

A crude drawing of a FinFET transistor

Esto permite un mejor control del canal entre la fuente y el drenaje del transistor. Esto me hizo pensar... ¿qué es lo que nos impide usar múltiples transistores que comparten la misma puerta?

A proposed design of transistors sharing the same gate

Creo que esto podría permitir un diseño analógico más complejo/eficiente en los circuitos. He buscado en vano ejemplos en Internet. A juzgar por el hecho de que no encontré nada, mi suposición es que afectaría el rendimiento eléctrico de los transistores. Sin embargo, no estoy seguro.

Mis preguntas:

  1. ¿Este diseño está realmente en práctica?

  2. De no ser así, ¿sería beneficioso que se utilizara este diseño cuando fuera aplicable?

  3. ¿Cómo afectaría esto al rendimiento eléctrico, si el efecto no es insignificante?

Lo siento si alguna de estas preguntas no son muy avanzadas o constructivas. Como dije, soy nuevo en este campo de estudio. De todos modos, ayudaría si pudiera recibir alguna retroalimentación. ¡Gracias de antemano!

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agfa555 Puntos 119

Dado que la anchura del canal viene determinada por la altura (y también por el grosor, que se quiere mantener pequeño) de la aleta, si se quiere una relación W/L grande (para conseguir, por ejemplo, una mayor corriente de drenaje), hay que crear finFETs de múltiples aletas, lo que da lugar a muchos finFETs en paralelo.

enter image description here

En la imagen anterior, la distancia entre el drenaje y la fuente (es decir, la anchura de la puerta azul, a lo largo del eje de la aleta) es la longitud del canal. La cantidad \$2\cdot H_{fin}+T_{fin}\$ define el ancho del canal.

También es posible que quieras compartir la puerta (sin conectar las fuentes y los drenajes en paralelo) en otras aplicaciones, como memorias o funciones lógicas.

Aquí se muestra una microscopía electrónica de varios finFETs que comparten la misma puerta.

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Como último comentario: Sé que esto sería bastante difícil de representar gráficamente, pero en tu imagen, la fina capa dieléctrica, que separa el sustrato de la puerta, ¡falta!

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